!回路規模削減/JavaRock
JavaRockで生成される回路規模を削減するぞ!!
という，強い意思でしばらくすすめてみよう，かと．
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で，とりあえず，敵を知り己を知れば云々に従って，
* どんな回路がFPGAで小さく実装できるか
* JavaRockのどの部分が大きさに影響しているか
を調べながら，削減方法を探ってみることに．
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昨夜，JavaRockの発表に際して共著の船田さんと，
FPGAでLUTは高価だよね，マルチプレクサでLUT消費されるよね，
という話になったので，マルチプレクサに着目してみる．
マルチプレクサといえば，まず思いつくのがステートマシンの駆動部分．
JavaRockでは，基本的に各文をステートに分割したステートマシンを構築するという
シンプルな変換をしているので，これが大きいのではないかと予想してみる．
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さて，まずは，↓のようなJavaプログラムをコンパイルしてみることを考える．
 public class for_test{
   int a;
   int b;
   public int test(int x){
     for(int i = 0; i < x; i++){
       a++;
     }
     for(int i = 0; i < x; i++){
       for(int j = 0; j < x; j++){
 	b++;
       }
     }
     return a + b;
   }
 }
これを普通にJavaRockでコンパイルして合成すると，↓のような回路になる．
{{ref_image for_test.png}}
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おおまかな構造としては，↓のようなステートマシンになっているので，
{{ref_image state_machine.png}}
とりあえず二つのforループを別のprocess文として外にだしてみることにする．
{{ref_image state_machine_mod.png}}
点線のところは，それぞれ，矢印の元のステートを監視して，
独立に駆動するようにしているので，メソッド呼出しと違って，呼出しにかかるサイクルのオーバヘッドはない．
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で合成したみたときの回路は↓のような感じ．
{{ref_image for_test2.png}}
JavaRockの生成した回路の真ん中にあるでかい回路がなくなって，
なんとなく回路がすっきりしているように，みえる．
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Synthesisしたとこでの結果は次の通り．
,,#. Slice Regs,#. Slice LUTs
,オリジナル,299,526
,改変後(一つ目のforループのみ),291,494
,改変後(二つのforループとも),310,538
,改変後(二つのforループの最内ループも),313,540
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一つ目のforループを改変した段階では効果ありか，とか思ったけど...いまいちだな．
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もう少し調べつつ，実装を検討しよう．
ちなみに，別プロセスに分けた変数同士に別々のレジスタを割り当てないといけないので，その点の考慮が必要．
前向きに考えれば，レジスタで処理を区切れるのでパイプライン化という方向にはすすみやすい．
また，逆に，分けたプロセスが，完全に独立している場合には，並列実行という方向も考えられる．